Quelle  other.json   Sprache: unbekannt

[
  {
    "EventCode": "0x1f05e",
    "EventName": "PM_1LPAR_CYC",
    "BriefDescription": "Number of cycles in single lpar mode. All threads in the core are assigned to the same lpar",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x2006e",
    "EventName": "PM_2LPAR_CYC",
    "BriefDescription": "Cycles in 2-lpar mode. Threads 0-3 belong to Lpar0 and threads 4-7 belong to Lpar1",
    "PublicDescription": "Number of cycles in 2 lpar mode"
  },
  {
    "EventCode": "0x4e05e",
    "EventName": "PM_4LPAR_CYC",
    "BriefDescription": "Number of cycles in 4 LPAR mode. Threads 0-1 belong to lpar0, threads 2-3 belong to lpar1, threads 4-5 belong to lpar2, and threads 6-7 belong to lpar3",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x610050",
    "EventName": "PM_ALL_CHIP_PUMP_CPRED",
    "BriefDescription": "Initial and Final Pump Scope was chip pump (prediction=correct) for all data types (demand load,data prefetch,inst prefetch,inst fetch,xlate)",
    "PublicDescription": "Initial and Final Pump Scope and data sourced across this scope was chip pump (prediction=correct) for all data types ( demand load,data,inst prefetch,inst fetch,xlate (I or d)"
  },
  {
    "EventCode": "0x520050",
    "EventName": "PM_ALL_GRP_PUMP_CPRED",
    "BriefDescription": "Initial and Final Pump Scope and data sourced across this scope was group pump for all data types (demand load,data prefetch,inst prefetch,inst fetch,xlate)",
    "PublicDescription": "Initial and Final Pump Scope and data sourced across this scope was group pump for all data types excluding data prefetch (demand load,inst prefetch,inst fetch,xlate)"
  },
  {
    "EventCode": "0x620052",
    "EventName": "PM_ALL_GRP_PUMP_MPRED",
    "BriefDescription": "Final Pump Scope (Group) ended up either larger or smaller than Initial Pump Scope for all data types (demand load,data prefetch,inst prefetch,inst fetch,xlate)",
    "PublicDescription": "Final Pump Scope(Group) to get data sourced, ended up larger than Initial Pump Scope OR Final Pump Scope(Group) got data from source that was at smaller scope(Chip) Final pump was group pump and initial pump was chip or final and initial pump was gro"
  },
  {
    "EventCode": "0x610052",
    "EventName": "PM_ALL_GRP_PUMP_MPRED_RTY",
    "BriefDescription": "Final Pump Scope (Group) ended up larger than Initial Pump Scope (Chip) for all data types (demand load,data prefetch,inst prefetch,inst fetch,xlate)",
    "PublicDescription": "Final Pump Scope(Group) to get data sourced, ended up larger than Initial Pump Scope (Chip) Final pump was group pump and initial pump was chip pumpfor all data types excluding data prefetch (demand load,inst prefetch,inst fetch,xlate)"
  },
  {
    "EventCode": "0x610054",
    "EventName": "PM_ALL_PUMP_CPRED",
    "BriefDescription": "Pump prediction correct. Counts across all types of pumps for all data types (demand load,data prefetch,inst prefetch,inst fetch,xlate)",
    "PublicDescription": "Pump prediction correct. Counts across all types of pumpsfor all data types excluding data prefetch (demand load,inst prefetch,inst fetch,xlate)"
  },
  {
    "EventCode": "0x640052",
    "EventName": "PM_ALL_PUMP_MPRED",
    "BriefDescription": "Pump misprediction. Counts across all types of pumps for all data types (demand load,data prefetch,inst prefetch,inst fetch,xlate)",
    "PublicDescription": "Pump Mis prediction Counts across all types of pumpsfor all data types excluding data prefetch (demand load,inst prefetch,inst fetch,xlate)"
  },
  {
    "EventCode": "0x630050",
    "EventName": "PM_ALL_SYS_PUMP_CPRED",
    "BriefDescription": "Initial and Final Pump Scope was system pump for all data types (demand load,data prefetch,inst prefetch,inst fetch,xlate)",
    "PublicDescription": "Initial and Final Pump Scope and data sourced across this scope was system pump for all data types excluding data prefetch (demand load,inst prefetch,inst fetch,xlate)"
  },
  {
    "EventCode": "0x630052",
    "EventName": "PM_ALL_SYS_PUMP_MPRED",
    "BriefDescription": "Final Pump Scope (system) mispredicted. Either the original scope was too small (Chip/Group) or the original scope was System and it should have been smaller. Counts for all data types (demand load,data prefetch,inst prefetch,inst fetch,xlate)",
    "PublicDescription": "Final Pump Scope(system) to get data sourced, ended up larger than Initial Pump Scope(Chip/Group) OR Final Pump Scope(system) got data from source that was at smaller scope(Chip/group) Final pump was system pump and initial pump was chip or group or"
  },
  {
    "EventCode": "0x640050",
    "EventName": "PM_ALL_SYS_PUMP_MPRED_RTY",
    "BriefDescription": "Final Pump Scope (system) ended up larger than Initial Pump Scope (Chip/Group) for all data types (demand load,data prefetch,inst prefetch,inst fetch,xlate)",
    "PublicDescription": "Final Pump Scope(system) to get data sourced, ended up larger than Initial Pump Scope (Chip or Group) for all data types excluding data prefetch (demand load,inst prefetch,inst fetch,xlate)"
  },
  {
    "EventCode": "0x4082",
    "EventName": "PM_BANK_CONFLICT",
    "BriefDescription": "Read blocked due to interleave conflict. The ifar logic will detect an interleave conflict and kill the data that was read that cycle",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x5086",
    "EventName": "PM_BR_BC_8",
    "BriefDescription": "Pairable BC+8 branch that has not been converted to a Resolve Finished in the BRU pipeline",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x5084",
    "EventName": "PM_BR_BC_8_CONV",
    "BriefDescription": "Pairable BC+8 branch that was converted to a Resolve Finished in the BRU pipeline",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x40ac",
    "EventName": "PM_BR_MPRED_CCACHE",
    "BriefDescription": "Conditional Branch Completed that was Mispredicted due to the Count Cache Target Prediction",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x40b8",
    "EventName": "PM_BR_MPRED_CR",
    "BriefDescription": "Conditional Branch Completed that was Mispredicted due to the BHT Direction Prediction (taken/not taken)",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x40ae",
    "EventName": "PM_BR_MPRED_LSTACK",
    "BriefDescription": "Conditional Branch Completed that was Mispredicted due to the Link Stack Target Prediction",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x40ba",
    "EventName": "PM_BR_MPRED_TA",
    "BriefDescription": "Conditional Branch Completed that was Mispredicted due to the Target Address Prediction from the Count Cache or Link Stack. Only XL-form branches that resolved Taken set this event",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x10138",
    "EventName": "PM_BR_MRK_2PATH",
    "BriefDescription": "marked two path branch",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x409c",
    "EventName": "PM_BR_PRED_BR0",
    "BriefDescription": "Conditional Branch Completed on BR0 (1st branch in group) in which the HW predicted the Direction or Target",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x409e",
    "EventName": "PM_BR_PRED_BR1",
    "BriefDescription": "Conditional Branch Completed on BR1 (2nd branch in group) in which the HW predicted the Direction or Target. Note: BR1 can only be used in Single Thread Mode. In all of the SMT modes, only one branch can complete, thus BR1 is unused",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x489c",
    "EventName": "PM_BR_PRED_BR_CMPL",
    "BriefDescription": "Completion Time Event. This event can also be calculated from the direct bus as follows: if_pc_br0_br_pred(0) OR if_pc_br0_br_pred(1)",
    "PublicDescription": "IFU"
  },
  {
    "EventCode": "0x40a4",
    "EventName": "PM_BR_PRED_CCACHE_BR0",
    "BriefDescription": "Conditional Branch Completed on BR0 that used the Count Cache for Target Prediction",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x40a6",
    "EventName": "PM_BR_PRED_CCACHE_BR1",
    "BriefDescription": "Conditional Branch Completed on BR1 that used the Count Cache for Target Prediction",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x48a4",
    "EventName": "PM_BR_PRED_CCACHE_CMPL",
    "BriefDescription": "Completion Time Event. This event can also be calculated from the direct bus as follows: if_pc_br0_br_pred(0) AND if_pc_br0_pred_type",
    "PublicDescription": "IFU"
  },
  {
    "EventCode": "0x40b0",
    "EventName": "PM_BR_PRED_CR_BR0",
    "BriefDescription": "Conditional Branch Completed on BR0 that had its direction predicted. I-form branches do not set this event. In addition, B-form branches which do not use the BHT do not set this event - these are branches with BO-field set to 'always taken' and branches",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x40b2",
    "EventName": "PM_BR_PRED_CR_BR1",
    "BriefDescription": "Conditional Branch Completed on BR1 that had its direction predicted. I-form branches do not set this event. In addition, B-form branches which do not use the BHT do not set this event - these are branches with BO-field set to 'always taken' and branches",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x48b0",
    "EventName": "PM_BR_PRED_CR_CMPL",
    "BriefDescription": "Completion Time Event. This event can also be calculated from the direct bus as follows: if_pc_br0_br_pred(1)='1'",
    "PublicDescription": "IFU"
  },
  {
    "EventCode": "0x40a8",
    "EventName": "PM_BR_PRED_LSTACK_BR0",
    "BriefDescription": "Conditional Branch Completed on BR0 that used the Link Stack for Target Prediction",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x40aa",
    "EventName": "PM_BR_PRED_LSTACK_BR1",
    "BriefDescription": "Conditional Branch Completed on BR1 that used the Link Stack for Target Prediction",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x48a8",
    "EventName": "PM_BR_PRED_LSTACK_CMPL",
    "BriefDescription": "Completion Time Event. This event can also be calculated from the direct bus as follows: if_pc_br0_br_pred(0) AND (not if_pc_br0_pred_type)",
    "PublicDescription": "IFU"
  },
  {
    "EventCode": "0x40b4",
    "EventName": "PM_BR_PRED_TA_BR0",
    "BriefDescription": "Conditional Branch Completed on BR0 that had its target address predicted. Only XL-form branches set this event",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x40b6",
    "EventName": "PM_BR_PRED_TA_BR1",
    "BriefDescription": "Conditional Branch Completed on BR1 that had its target address predicted. Only XL-form branches set this event",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x48b4",
    "EventName": "PM_BR_PRED_TA_CMPL",
    "BriefDescription": "Completion Time Event. This event can also be calculated from the direct bus as follows: if_pc_br0_br_pred(0)='1'",
    "PublicDescription": "IFU"
  },
  {
    "EventCode": "0x40a0",
    "EventName": "PM_BR_UNCOND_BR0",
    "BriefDescription": "Unconditional Branch Completed on BR0. HW branch prediction was not used for this branch. This can be an I-form branch, a B-form branch with BO-field set to branch always, or a B-form branch which was coverted to a Resolve",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x40a2",
    "EventName": "PM_BR_UNCOND_BR1",
    "BriefDescription": "Unconditional Branch Completed on BR1. HW branch prediction was not used for this branch. This can be an I-form branch, a B-form branch with BO-field set to branch always, or a B-form branch which was coverted to a Resolve",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x48a0",
    "EventName": "PM_BR_UNCOND_CMPL",
    "BriefDescription": "Completion Time Event. This event can also be calculated from the direct bus as follows: if_pc_br0_br_pred=00 AND if_pc_br0_completed",
    "PublicDescription": "IFU"
  },
  {
    "EventCode": "0x3094",
    "EventName": "PM_CASTOUT_ISSUED",
    "BriefDescription": "Castouts issued",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x3096",
    "EventName": "PM_CASTOUT_ISSUED_GPR",
    "BriefDescription": "Castouts issued GPR",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x2090",
    "EventName": "PM_CLB_HELD",
    "BriefDescription": "CLB Hold: Any Reason",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x2d018",
    "EventName": "PM_CMPLU_STALL_BRU_CRU",
    "BriefDescription": "Completion stall due to IFU",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x30026",
    "EventName": "PM_CMPLU_STALL_COQ_FULL",
    "BriefDescription": "Completion stall due to CO q full",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x30038",
    "EventName": "PM_CMPLU_STALL_FLUSH",
    "BriefDescription": "completion stall due to flush by own thread",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x30028",
    "EventName": "PM_CMPLU_STALL_MEM_ECC_DELAY",
    "BriefDescription": "Completion stall due to mem ECC delay",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x2e01c",
    "EventName": "PM_CMPLU_STALL_NO_NTF",
    "BriefDescription": "Completion stall due to nop",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x2e01e",
    "EventName": "PM_CMPLU_STALL_NTCG_FLUSH",
    "BriefDescription": "Completion stall due to ntcg flush",
    "PublicDescription": "Completion stall due to reject (load hit store)"
  },
  {
    "EventCode": "0x4c010",
    "EventName": "PM_CMPLU_STALL_REJECT",
    "BriefDescription": "Completion stall due to LSU reject",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x2c01a",
    "EventName": "PM_CMPLU_STALL_REJECT_LHS",
    "BriefDescription": "Completion stall due to reject (load hit store)",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x4c014",
    "EventName": "PM_CMPLU_STALL_REJ_LMQ_FULL",
    "BriefDescription": "Completion stall due to LSU reject LMQ full",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x4d010",
    "EventName": "PM_CMPLU_STALL_SCALAR",
    "BriefDescription": "Completion stall due to VSU scalar instruction",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x2d010",
    "EventName": "PM_CMPLU_STALL_SCALAR_LONG",
    "BriefDescription": "Completion stall due to VSU scalar long latency instruction",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x2c014",
    "EventName": "PM_CMPLU_STALL_STORE",
    "BriefDescription": "Completion stall by stores this includes store agen finishes in pipe LS0/LS1 and store data finishes in LS2/LS3",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x2d014",
    "EventName": "PM_CMPLU_STALL_VECTOR",
    "BriefDescription": "Completion stall due to VSU vector instruction",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x4d012",
    "EventName": "PM_CMPLU_STALL_VECTOR_LONG",
    "BriefDescription": "Completion stall due to VSU vector long instruction",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x2d012",
    "EventName": "PM_CMPLU_STALL_VSU",
    "BriefDescription": "Completion stall due to VSU instruction",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x16083",
    "EventName": "PM_CO0_ALLOC",
    "BriefDescription": "CO mach 0 Busy. Used by PMU to sample ave RC livetime(mach0 used as sample point)",
    "PublicDescription": "0.0"
  },
  {
    "EventCode": "0x16082",
    "EventName": "PM_CO0_BUSY",
    "BriefDescription": "CO mach 0 Busy. Used by PMU to sample ave RC livetime(mach0 used as sample point)",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x3608a",
    "EventName": "PM_CO_USAGE",
    "BriefDescription": "Continuous 16 cycle(2to1) window where this signals rotates thru sampling each L2 CO machine busy. PMU uses this wave to then do 16 cyc count to sample total number of machs running",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x40066",
    "EventName": "PM_CRU_FIN",
    "BriefDescription": "IFU Finished a (non-branch) instruction",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x61c050",
    "EventName": "PM_DATA_ALL_CHIP_PUMP_CPRED",
    "BriefDescription": "Initial and Final Pump Scope was chip pump (prediction=correct) for either demand loads or data prefetch",
    "PublicDescription": "Initial and Final Pump Scope and data sourced across this scope was chip pump (prediction=correct) for a demand load"
  },
  {
    "EventCode": "0x64c048",
    "EventName": "PM_DATA_ALL_FROM_DL2L3_MOD",
    "BriefDescription": "The processor's data cache was reloaded with Modified (M) data from another chip's L2 or L3 on a different Node or Group (Distant), as this chip due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded with Modified (M) data from another chip's L2 or L3 on a different Node or Group (Distant), as this chip due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x63c048",
    "EventName": "PM_DATA_ALL_FROM_DL2L3_SHR",
    "BriefDescription": "The processor's data cache was reloaded with Shared (S) data from another chip's L2 or L3 on a different Node or Group (Distant), as this chip due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded with Shared (S) data from another chip's L2 or L3 on a different Node or Group (Distant), as this chip due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x63c04c",
    "EventName": "PM_DATA_ALL_FROM_DL4",
    "BriefDescription": "The processor's data cache was reloaded from another chip's L4 on a different Node or Group (Distant) due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded from another chip's L4 on a different Node or Group (Distant) due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x64c04c",
    "EventName": "PM_DATA_ALL_FROM_DMEM",
    "BriefDescription": "The processor's data cache was reloaded from another chip's memory on the same Node or Group (Distant) due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded from another chip's memory on the same Node or Group (Distant) due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x61c042",
    "EventName": "PM_DATA_ALL_FROM_L2",
    "BriefDescription": "The processor's data cache was reloaded from local core's L2 due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded from local core's L2 due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x64c046",
    "EventName": "PM_DATA_ALL_FROM_L21_MOD",
    "BriefDescription": "The processor's data cache was reloaded with Modified (M) data from another core's L2 on the same chip due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded with Modified (M) data from another core's L2 on the same chip due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x63c046",
    "EventName": "PM_DATA_ALL_FROM_L21_SHR",
    "BriefDescription": "The processor's data cache was reloaded with Shared (S) data from another core's L2 on the same chip due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded with Shared (S) data from another core's L2 on the same chip due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x61c04e",
    "EventName": "PM_DATA_ALL_FROM_L2MISS_MOD",
    "BriefDescription": "The processor's data cache was reloaded from a location other than the local core's L2 due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded from a location other than the local core's L2 due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x63c040",
    "EventName": "PM_DATA_ALL_FROM_L2_DISP_CONFLICT_LDHITST",
    "BriefDescription": "The processor's data cache was reloaded from local core's L2 with load hit store conflict due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded from local core's L2 with load hit store conflict due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x64c040",
    "EventName": "PM_DATA_ALL_FROM_L2_DISP_CONFLICT_OTHER",
    "BriefDescription": "The processor's data cache was reloaded from local core's L2 with dispatch conflict due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded from local core's L2 with dispatch conflict due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x62c040",
    "EventName": "PM_DATA_ALL_FROM_L2_MEPF",
    "BriefDescription": "The processor's data cache was reloaded from local core's L2 hit without dispatch conflicts on Mepf state due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded from local core's L2 hit without dispatch conflicts on Mepf state due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x61c040",
    "EventName": "PM_DATA_ALL_FROM_L2_NO_CONFLICT",
    "BriefDescription": "The processor's data cache was reloaded from local core's L2 without conflict due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded from local core's L2 without conflict due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x64c042",
    "EventName": "PM_DATA_ALL_FROM_L3",
    "BriefDescription": "The processor's data cache was reloaded from local core's L3 due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded from local core's L3 due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x64c044",
    "EventName": "PM_DATA_ALL_FROM_L31_ECO_MOD",
    "BriefDescription": "The processor's data cache was reloaded with Modified (M) data from another core's ECO L3 on the same chip due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded with Modified (M) data from another core's ECO L3 on the same chip due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x63c044",
    "EventName": "PM_DATA_ALL_FROM_L31_ECO_SHR",
    "BriefDescription": "The processor's data cache was reloaded with Shared (S) data from another core's ECO L3 on the same chip due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded with Shared (S) data from another core's ECO L3 on the same chip due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x62c044",
    "EventName": "PM_DATA_ALL_FROM_L31_MOD",
    "BriefDescription": "The processor's data cache was reloaded with Modified (M) data from another core's L3 on the same chip due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded with Modified (M) data from another core's L3 on the same chip due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x61c046",
    "EventName": "PM_DATA_ALL_FROM_L31_SHR",
    "BriefDescription": "The processor's data cache was reloaded with Shared (S) data from another core's L3 on the same chip due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded with Shared (S) data from another core's L3 on the same chip due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x64c04e",
    "EventName": "PM_DATA_ALL_FROM_L3MISS_MOD",
    "BriefDescription": "The processor's data cache was reloaded from a location other than the local core's L3 due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded from a location other than the local core's L3 due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x63c042",
    "EventName": "PM_DATA_ALL_FROM_L3_DISP_CONFLICT",
    "BriefDescription": "The processor's data cache was reloaded from local core's L3 with dispatch conflict due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded from local core's L3 with dispatch conflict due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x62c042",
    "EventName": "PM_DATA_ALL_FROM_L3_MEPF",
    "BriefDescription": "The processor's data cache was reloaded from local core's L3 without dispatch conflicts hit on Mepf state due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded from local core's L3 without dispatch conflicts hit on Mepf state due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x61c044",
    "EventName": "PM_DATA_ALL_FROM_L3_NO_CONFLICT",
    "BriefDescription": "The processor's data cache was reloaded from local core's L3 without conflict due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded from local core's L3 without conflict due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x61c04c",
    "EventName": "PM_DATA_ALL_FROM_LL4",
    "BriefDescription": "The processor's data cache was reloaded from the local chip's L4 cache due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded from the local chip's L4 cache due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x62c048",
    "EventName": "PM_DATA_ALL_FROM_LMEM",
    "BriefDescription": "The processor's data cache was reloaded from the local chip's Memory due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded from the local chip's Memory due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x62c04c",
    "EventName": "PM_DATA_ALL_FROM_MEMORY",
    "BriefDescription": "The processor's data cache was reloaded from a memory location including L4 from local remote or distant due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded from a memory location including L4 from local remote or distant due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x64c04a",
    "EventName": "PM_DATA_ALL_FROM_OFF_CHIP_CACHE",
    "BriefDescription": "The processor's data cache was reloaded either shared or modified data from another core's L2/L3 on a different chip (remote or distant) due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded either shared or modified data from another core's L2/L3 on a different chip (remote or distant) due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x61c048",
    "EventName": "PM_DATA_ALL_FROM_ON_CHIP_CACHE",
    "BriefDescription": "The processor's data cache was reloaded either shared or modified data from another core's L2/L3 on the same chip due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded either shared or modified data from another core's L2/L3 on the same chip due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x62c046",
    "EventName": "PM_DATA_ALL_FROM_RL2L3_MOD",
    "BriefDescription": "The processor's data cache was reloaded with Modified (M) data from another chip's L2 or L3 on the same Node or Group (Remote), as this chip due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded with Modified (M) data from another chip's L2 or L3 on the same Node or Group (Remote), as this chip due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x61c04a",
    "EventName": "PM_DATA_ALL_FROM_RL2L3_SHR",
    "BriefDescription": "The processor's data cache was reloaded with Shared (S) data from another chip's L2 or L3 on the same Node or Group (Remote), as this chip due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded with Shared (S) data from another chip's L2 or L3 on the same Node or Group (Remote), as this chip due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x62c04a",
    "EventName": "PM_DATA_ALL_FROM_RL4",
    "BriefDescription": "The processor's data cache was reloaded from another chip's L4 on the same Node or Group ( Remote) due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded from another chip's L4 on the same Node or Group ( Remote) due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x63c04a",
    "EventName": "PM_DATA_ALL_FROM_RMEM",
    "BriefDescription": "The processor's data cache was reloaded from another chip's memory on the same Node or Group ( Remote) due to either demand loads or data prefetch",
    "PublicDescription": "The processor's data cache was reloaded from another chip's memory on the same Node or Group ( Remote) due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x62c050",
    "EventName": "PM_DATA_ALL_GRP_PUMP_CPRED",
    "BriefDescription": "Initial and Final Pump Scope was group pump (prediction=correct) for either demand loads or data prefetch",
    "PublicDescription": "Initial and Final Pump Scope and data sourced across this scope was group pump for a demand load"
  },
  {
    "EventCode": "0x62c052",
    "EventName": "PM_DATA_ALL_GRP_PUMP_MPRED",
    "BriefDescription": "Final Pump Scope (Group) ended up either larger or smaller than Initial Pump Scope for either demand loads or data prefetch",
    "PublicDescription": "Final Pump Scope(Group) to get data sourced, ended up larger than Initial Pump Scope OR Final Pump Scope(Group) got data from source that was at smaller scope(Chip) Final pump was group pump and initial pump was chip or final and initial pump was gro"
  },
  {
    "EventCode": "0x61c052",
    "EventName": "PM_DATA_ALL_GRP_PUMP_MPRED_RTY",
    "BriefDescription": "Final Pump Scope (Group) ended up larger than Initial Pump Scope (Chip) for either demand loads or data prefetch",
    "PublicDescription": "Final Pump Scope(Group) to get data sourced, ended up larger than Initial Pump Scope (Chip) Final pump was group pump and initial pump was chip pumpfor a demand load"
  },
  {
    "EventCode": "0x61c054",
    "EventName": "PM_DATA_ALL_PUMP_CPRED",
    "BriefDescription": "Pump prediction correct. Counts across all types of pumps for either demand loads or data prefetch",
    "PublicDescription": "Pump prediction correct. Counts across all types of pumps for a demand load"
  },
  {
    "EventCode": "0x64c052",
    "EventName": "PM_DATA_ALL_PUMP_MPRED",
    "BriefDescription": "Pump misprediction. Counts across all types of pumps for either demand loads or data prefetch",
    "PublicDescription": "Pump Mis prediction Counts across all types of pumpsfor a demand load"
  },
  {
    "EventCode": "0x63c050",
    "EventName": "PM_DATA_ALL_SYS_PUMP_CPRED",
    "BriefDescription": "Initial and Final Pump Scope was system pump (prediction=correct) for either demand loads or data prefetch",
    "PublicDescription": "Initial and Final Pump Scope and data sourced across this scope was system pump for a demand load"
  },
  {
    "EventCode": "0x63c052",
    "EventName": "PM_DATA_ALL_SYS_PUMP_MPRED",
    "BriefDescription": "Final Pump Scope (system) mispredicted. Either the original scope was too small (Chip/Group) or the original scope was System and it should have been smaller. Counts for either demand loads or data prefetch",
    "PublicDescription": "Final Pump Scope(system) to get data sourced, ended up larger than Initial Pump Scope(Chip/Group) OR Final Pump Scope(system) got data from source that was at smaller scope(Chip/group) Final pump was system pump and initial pump was chip or group or"
  },
  {
    "EventCode": "0x64c050",
    "EventName": "PM_DATA_ALL_SYS_PUMP_MPRED_RTY",
    "BriefDescription": "Final Pump Scope (system) ended up larger than Initial Pump Scope (Chip/Group) for either demand loads or data prefetch",
    "PublicDescription": "Final Pump Scope(system) to get data sourced, ended up larger than Initial Pump Scope (Chip or Group) for a demand load"
  },
  {
    "EventCode": "0x4c046",
    "EventName": "PM_DATA_FROM_L21_MOD",
    "BriefDescription": "The processor's data cache was reloaded with Modified (M) data from another core's L2 on the same chip due to a demand load",
    "PublicDescription": "The processor's data cache was reloaded with Modified (M) data from another core's L2 on the same chip due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x3c046",
    "EventName": "PM_DATA_FROM_L21_SHR",
    "BriefDescription": "The processor's data cache was reloaded with Shared (S) data from another core's L2 on the same chip due to a demand load",
    "PublicDescription": "The processor's data cache was reloaded with Shared (S) data from another core's L2 on the same chip due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x4c044",
    "EventName": "PM_DATA_FROM_L31_ECO_MOD",
    "BriefDescription": "The processor's data cache was reloaded with Modified (M) data from another core's ECO L3 on the same chip due to a demand load",
    "PublicDescription": "The processor's data cache was reloaded with Modified (M) data from another core's ECO L3 on the same chip due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x3c044",
    "EventName": "PM_DATA_FROM_L31_ECO_SHR",
    "BriefDescription": "The processor's data cache was reloaded with Shared (S) data from another core's ECO L3 on the same chip due to a demand load",
    "PublicDescription": "The processor's data cache was reloaded with Shared (S) data from another core's ECO L3 on the same chip due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x2c044",
    "EventName": "PM_DATA_FROM_L31_MOD",
    "BriefDescription": "The processor's data cache was reloaded with Modified (M) data from another core's L3 on the same chip due to a demand load",
    "PublicDescription": "The processor's data cache was reloaded with Modified (M) data from another core's L3 on the same chip due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x1c046",
    "EventName": "PM_DATA_FROM_L31_SHR",
    "BriefDescription": "The processor's data cache was reloaded with Shared (S) data from another core's L3 on the same chip due to a demand load",
    "PublicDescription": "The processor's data cache was reloaded with Shared (S) data from another core's L3 on the same chip due to either only demand loads or demand loads plus prefetches if MMCR1[16] is 1"
  },
  {
    "EventCode": "0x400fe",
    "EventName": "PM_DATA_FROM_MEM",
    "BriefDescription": "The processor's data cache was reloaded from a memory location including L4 from local remote or distant due to a demand load",
    "PublicDescription": "Data cache reload from memory (including L4)"
  },
  {
    "EventCode": "0xe0bc",
    "EventName": "PM_DC_COLLISIONS",
    "BriefDescription": "DATA Cache collisions",
    "PublicDescription": "DATA Cache collisions42"
  },
  {
    "EventCode": "0x1e050",
    "EventName": "PM_DC_PREF_STREAM_ALLOC",
    "BriefDescription": "Stream marked valid. The stream could have been allocated through the hardware prefetch mechanism or through software. This is combined ls0 and ls1",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x2e050",
    "EventName": "PM_DC_PREF_STREAM_CONF",
    "BriefDescription": "A demand load referenced a line in an active prefetch stream. The stream could have been allocated through the hardware prefetch mechanism or through software. Combine up + down",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x4e050",
    "EventName": "PM_DC_PREF_STREAM_FUZZY_CONF",
    "BriefDescription": "A demand load referenced a line in an active fuzzy prefetch stream. The stream could have been allocated through the hardware prefetch mechanism or through software.Fuzzy stream confirm (out of order effects, or pf cant keep up)",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x3e050",
    "EventName": "PM_DC_PREF_STREAM_STRIDED_CONF",
    "BriefDescription": "A demand load referenced a line in an active strided prefetch stream. The stream could have been allocated through the hardware prefetch mechanism or through software",
    "PublicDescription": ""
  },
  {
    "EventCode": "0xb0ba",
    "EventName": "PM_DFU",
    "BriefDescription": "Finish DFU (all finish)",
    "PublicDescription": ""
  },
  {
    "EventCode": "0xb0be",
    "EventName": "PM_DFU_DCFFIX",
    "BriefDescription": "Convert from fixed opcode finish (dcffix,dcffixq)",
    "PublicDescription": ""
  },
  {
    "EventCode": "0xb0bc",
    "EventName": "PM_DFU_DENBCD",
    "BriefDescription": "BCD->DPD opcode finish (denbcd, denbcdq)",
    "PublicDescription": ""
  },
  {
    "EventCode": "0xb0b8",
    "EventName": "PM_DFU_MC",
    "BriefDescription": "Finish DFU multicycle",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x2092",
    "EventName": "PM_DISP_CLB_HELD_BAL",
    "BriefDescription": "Dispatch/CLB Hold: Balance",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x2094",
    "EventName": "PM_DISP_CLB_HELD_RES",
    "BriefDescription": "Dispatch/CLB Hold: Resource",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x20a8",
    "EventName": "PM_DISP_CLB_HELD_SB",
    "BriefDescription": "Dispatch/CLB Hold: Scoreboard",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x2098",
    "EventName": "PM_DISP_CLB_HELD_SYNC",
    "BriefDescription": "Dispatch/CLB Hold: Sync type instruction",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x2096",
    "EventName": "PM_DISP_CLB_HELD_TLBIE",
    "BriefDescription": "Dispatch Hold: Due to TLBIE",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x20006",
    "EventName": "PM_DISP_HELD_IQ_FULL",
    "BriefDescription": "Dispatch held due to Issue q full",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x1002a",
    "EventName": "PM_DISP_HELD_MAP_FULL",
    "BriefDescription": "Dispatch for this thread was held because the Mappers were full",
    "PublicDescription": "Dispatch held due to Mapper full"
  },
  {
    "EventCode": "0x30018",
    "EventName": "PM_DISP_HELD_SRQ_FULL",
    "BriefDescription": "Dispatch held due SRQ no room",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x30a6",
    "EventName": "PM_DISP_HOLD_GCT_FULL",
    "BriefDescription": "Dispatch Hold Due to no space in the GCT",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x30008",
    "EventName": "PM_DISP_WT",
    "BriefDescription": "Dispatched Starved",
    "PublicDescription": "Dispatched Starved (not held, nothing to dispatch)"
  },
  {
    "EventCode": "0x4e046",
    "EventName": "PM_DPTEG_FROM_L21_MOD",
    "BriefDescription": "A Page Table Entry was loaded into the TLB with Modified (M) data from another core's L2 on the same chip due to a data side request",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x3e046",
    "EventName": "PM_DPTEG_FROM_L21_SHR",
    "BriefDescription": "A Page Table Entry was loaded into the TLB with Shared (S) data from another core's L2 on the same chip due to a data side request",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x3e040",
    "EventName": "PM_DPTEG_FROM_L2_DISP_CONFLICT_LDHITST",
    "BriefDescription": "A Page Table Entry was loaded into the TLB from local core's L2 with load hit store conflict due to a data side request",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x4e040",
    "EventName": "PM_DPTEG_FROM_L2_DISP_CONFLICT_OTHER",
    "BriefDescription": "A Page Table Entry was loaded into the TLB from local core's L2 with dispatch conflict due to a data side request",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x4e044",
    "EventName": "PM_DPTEG_FROM_L31_ECO_MOD",
    "BriefDescription": "A Page Table Entry was loaded into the TLB with Modified (M) data from another core's ECO L3 on the same chip due to a data side request",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x3e044",
    "EventName": "PM_DPTEG_FROM_L31_ECO_SHR",
    "BriefDescription": "A Page Table Entry was loaded into the TLB with Shared (S) data from another core's ECO L3 on the same chip due to a data side request",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x2e044",
    "EventName": "PM_DPTEG_FROM_L31_MOD",
    "BriefDescription": "A Page Table Entry was loaded into the TLB with Modified (M) data from another core's L3 on the same chip due to a data side request",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x1e046",
    "EventName": "PM_DPTEG_FROM_L31_SHR",
    "BriefDescription": "A Page Table Entry was loaded into the TLB with Shared (S) data from another core's L3 on the same chip due to a data side request",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x50a8",
    "EventName": "PM_EAT_FORCE_MISPRED",
    "BriefDescription": "XL-form branch was mispredicted due to the predicted target address missing from EAT. The EAT forces a mispredict in this case since there is no predicated target to validate. This is a rare case that may occur when the EAT is full and a branch is issue",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x4084",
    "EventName": "PM_EAT_FULL_CYC",
    "BriefDescription": "Cycles No room in EAT",
    "PublicDescription": "Cycles No room in EATSet on bank conflict and case where no ibuffers available"
  },
  {
    "EventCode": "0x2080",
    "EventName": "PM_EE_OFF_EXT_INT",
    "BriefDescription": "Ee off and external interrupt",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x20b4",
    "EventName": "PM_FAV_TBEGIN",
    "BriefDescription": "Dispatch time Favored tbegin",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x100f4",
    "EventName": "PM_FLOP",
    "BriefDescription": "Floating Point Operation Finished",
    "PublicDescription": "Floating Point Operations Finished"
  },
  {
    "EventCode": "0xa0ae",
    "EventName": "PM_FLOP_SUM_SCALAR",
    "BriefDescription": "flops summary scalar instructions",
    "PublicDescription": ""
  },
  {
    "EventCode": "0xa0ac",
    "EventName": "PM_FLOP_SUM_VEC",
    "BriefDescription": "flops summary vector instructions",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x2084",
    "EventName": "PM_FLUSH_BR_MPRED",
    "BriefDescription": "Flush caused by branch mispredict",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x2082",
    "EventName": "PM_FLUSH_DISP",
    "BriefDescription": "Dispatch flush",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x208c",
    "EventName": "PM_FLUSH_DISP_SB",
    "BriefDescription": "Dispatch Flush: Scoreboard",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x2088",
    "EventName": "PM_FLUSH_DISP_SYNC",
    "BriefDescription": "Dispatch Flush: Sync",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x208a",
    "EventName": "PM_FLUSH_DISP_TLBIE",
    "BriefDescription": "Dispatch Flush: TLBIE",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x208e",
    "EventName": "PM_FLUSH_LSU",
    "BriefDescription": "Flush initiated by LSU",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x2086",
    "EventName": "PM_FLUSH_PARTIAL",
    "BriefDescription": "Partial flush",
    "PublicDescription": ""
  },
  {
    "EventCode": "0xa0b0",
    "EventName": "PM_FPU0_FCONV",
    "BriefDescription": "Convert instruction executed",
    "PublicDescription": ""
  },
  {
    "EventCode": "0xa0b8",
    "EventName": "PM_FPU0_FEST",
    "BriefDescription": "Estimate instruction executed",
    "PublicDescription": ""
  },
  {
    "EventCode": "0xa0b4",
    "EventName": "PM_FPU0_FRSP",
    "BriefDescription": "Round to single precision instruction executed",
    "PublicDescription": ""
  },
  {
    "EventCode": "0xa0b2",
    "EventName": "PM_FPU1_FCONV",
    "BriefDescription": "Convert instruction executed",
    "PublicDescription": ""
  },
  {
    "EventCode": "0xa0ba",
    "EventName": "PM_FPU1_FEST",
    "BriefDescription": "Estimate instruction executed",
    "PublicDescription": ""
  },
  {
    "EventCode": "0xa0b6",
    "EventName": "PM_FPU1_FRSP",
    "BriefDescription": "Round to single precision instruction executed",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x50b0",
    "EventName": "PM_FUSION_TOC_GRP0_1",
    "BriefDescription": "One pair of instructions fused with TOC in Group0",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x50ae",
    "EventName": "PM_FUSION_TOC_GRP0_2",
    "BriefDescription": "Two pairs of instructions fused with TOCin Group0",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x50ac",
    "EventName": "PM_FUSION_TOC_GRP0_3",
    "BriefDescription": "Three pairs of instructions fused with TOC in Group0",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x50b2",
    "EventName": "PM_FUSION_TOC_GRP1_1",
    "BriefDescription": "One pair of instructions fused with TOX in Group1",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x50b8",
    "EventName": "PM_FUSION_VSX_GRP0_1",
    "BriefDescription": "One pair of instructions fused with VSX in Group0",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x50b6",
    "EventName": "PM_FUSION_VSX_GRP0_2",
    "BriefDescription": "Two pairs of instructions fused with VSX in Group0",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x50b4",
    "EventName": "PM_FUSION_VSX_GRP0_3",
    "BriefDescription": "Three pairs of instructions fused with VSX in Group0",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x50ba",
    "EventName": "PM_FUSION_VSX_GRP1_1",
    "BriefDescription": "One pair of instructions fused with VSX in Group1",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x3000e",
    "EventName": "PM_FXU0_BUSY_FXU1_IDLE",
    "BriefDescription": "fxu0 busy and fxu1 idle",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x10004",
    "EventName": "PM_FXU0_FIN",
    "BriefDescription": "The fixed point unit Unit 0 finished an instruction. Instructions that finish may not necessary complete",
    "PublicDescription": "FXU0 Finished"
  },
  {
    "EventCode": "0x4000e",
    "EventName": "PM_FXU1_BUSY_FXU0_IDLE",
    "BriefDescription": "fxu0 idle and fxu1 busy",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x40004",
    "EventName": "PM_FXU1_FIN",
    "BriefDescription": "FXU1 Finished",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x20008",
    "EventName": "PM_GCT_EMPTY_CYC",
    "BriefDescription": "No itags assigned either thread (GCT Empty)",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x30a4",
    "EventName": "PM_GCT_MERGE",
    "BriefDescription": "Group dispatched on a merged GCT empty. GCT entries can be merged only within the same thread",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x4d01e",
    "EventName": "PM_GCT_NOSLOT_BR_MPRED",
    "BriefDescription": "Gct empty for this thread due to branch mispred",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x4d01a",
    "EventName": "PM_GCT_NOSLOT_BR_MPRED_ICMISS",
    "BriefDescription": "Gct empty for this thread due to Icache Miss and branch mispred",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x100f8",
    "EventName": "PM_GCT_NOSLOT_CYC",
    "BriefDescription": "No itags assigned",
    "PublicDescription": "Pipeline empty (No itags assigned , no GCT slots used)"
  },
  {
    "EventCode": "0x2d01e",
    "EventName": "PM_GCT_NOSLOT_DISP_HELD_ISSQ",
    "BriefDescription": "Gct empty for this thread due to dispatch hold on this thread due to Issue q full",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x4d01c",
    "EventName": "PM_GCT_NOSLOT_DISP_HELD_MAP",
    "BriefDescription": "Gct empty for this thread due to dispatch hold on this thread due to Mapper full",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x2e010",
    "EventName": "PM_GCT_NOSLOT_DISP_HELD_OTHER",
    "BriefDescription": "Gct empty for this thread due to dispatch hold on this thread due to sync",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x2d01c",
    "EventName": "PM_GCT_NOSLOT_DISP_HELD_SRQ",
    "BriefDescription": "Gct empty for this thread due to dispatch hold on this thread due to SRQ full",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x4e010",
    "EventName": "PM_GCT_NOSLOT_IC_L3MISS",
    "BriefDescription": "Gct empty for this thread due to icache l3 miss",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x2d01a",
    "EventName": "PM_GCT_NOSLOT_IC_MISS",
    "BriefDescription": "Gct empty for this thread due to Icache Miss",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x20a2",
    "EventName": "PM_GCT_UTIL_11_14_ENTRIES",
    "BriefDescription": "GCT Utilization 11-14 entries",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x20a4",
    "EventName": "PM_GCT_UTIL_15_17_ENTRIES",
    "BriefDescription": "GCT Utilization 15-17 entries",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x20a6",
    "EventName": "PM_GCT_UTIL_18_ENTRIES",
    "BriefDescription": "GCT Utilization 18+ entries",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x209c",
    "EventName": "PM_GCT_UTIL_1_2_ENTRIES",
    "BriefDescription": "GCT Utilization 1-2 entries",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x209e",
    "EventName": "PM_GCT_UTIL_3_6_ENTRIES",
    "BriefDescription": "GCT Utilization 3-6 entries",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x20a0",
    "EventName": "PM_GCT_UTIL_7_10_ENTRIES",
    "BriefDescription": "GCT Utilization 7-10 entries",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x1000a",
    "EventName": "PM_GRP_BR_MPRED_NONSPEC",
    "BriefDescription": "Group experienced non-speculative branch redirect",
    "PublicDescription": "Group experienced Non-speculative br mispredicct"
  },
  {
    "EventCode": "0x30004",
    "EventName": "PM_GRP_CMPL",
    "BriefDescription": "group completed",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x3000a",
    "EventName": "PM_GRP_DISP",
    "BriefDescription": "group dispatch",
    "PublicDescription": "dispatch_success (Group Dispatched)"
  },
  {
    "EventCode": "0x1000c",
    "EventName": "PM_GRP_IC_MISS_NONSPEC",
    "BriefDescription": "Group experienced non-speculative I cache miss",
    "PublicDescription": "Group experi enced Non-specu lative I cache miss"
  },
  {
    "EventCode": "0x10130",
    "EventName": "PM_GRP_MRK",
    "BriefDescription": "Instruction Marked",
    "PublicDescription": "Instruction marked in idu"
  },
  {
    "EventCode": "0x509c",
    "EventName": "PM_GRP_NON_FULL_GROUP",
    "BriefDescription": "GROUPs where we did not have 6 non branch instructions in the group(ST mode), in SMT mode 3 non branches",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x50a4",
    "EventName": "PM_GRP_TERM_2ND_BRANCH",
    "BriefDescription": "There were enough instructions in the Ibuffer, but 2nd branch ends group",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x50a6",
    "EventName": "PM_GRP_TERM_FPU_AFTER_BR",
    "BriefDescription": "There were enough instructions in the Ibuffer, but FPU OP IN same group after a branch terminates a group, cant do partial flushes",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x509e",
    "EventName": "PM_GRP_TERM_NOINST",
    "BriefDescription": "Do not fill every slot in the group, Not enough instructions in the Ibuffer. This includes cases where the group started with enough instructions, but some got knocked out by a cache miss or branch redirect (which would also empty the Ibuffer)",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x50a0",
    "EventName": "PM_GRP_TERM_OTHER",
    "BriefDescription": "There were enough instructions in the Ibuffer, but the group terminated early for some other reason, most likely due to a First or Last",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x50a2",
    "EventName": "PM_GRP_TERM_SLOT_LIMIT",
    "BriefDescription": "There were enough instructions in the Ibuffer, but 3 src RA/RB/RC , 2 way crack caused a group termination",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x4086",
    "EventName": "PM_IBUF_FULL_CYC",
    "BriefDescription": "Cycles No room in ibuff",
    "PublicDescription": "Cycles No room in ibufffully qualified transfer (if5 valid)"
  },
  {
    "EventCode": "0x4098",
    "EventName": "PM_IC_DEMAND_L2_BHT_REDIRECT",
    "BriefDescription": "L2 I cache demand request due to BHT redirect, branch redirect ( 2 bubbles 3 cycles)",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x409a",
    "EventName": "PM_IC_DEMAND_L2_BR_REDIRECT",
    "BriefDescription": "L2 I cache demand request due to branch Mispredict ( 15 cycle path)",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x4088",
    "EventName": "PM_IC_DEMAND_REQ",
    "BriefDescription": "Demand Instruction fetch request",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x508a",
    "EventName": "PM_IC_INVALIDATE",
    "BriefDescription": "Ic line invalidated",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x4092",
    "EventName": "PM_IC_PREF_CANCEL_HIT",
    "BriefDescription": "Prefetch Canceled due to icache hit",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x4094",
    "EventName": "PM_IC_PREF_CANCEL_L2",
    "BriefDescription": "L2 Squashed request",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x4090",
    "EventName": "PM_IC_PREF_CANCEL_PAGE",
    "BriefDescription": "Prefetch Canceled due to page boundary",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x408a",
    "EventName": "PM_IC_PREF_REQ",
    "BriefDescription": "Instruction prefetch requests",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x408e",
    "EventName": "PM_IC_PREF_WRITE",
    "BriefDescription": "Instruction prefetch written into IL1",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x4096",
    "EventName": "PM_IC_RELOAD_PRIVATE",
    "BriefDescription": "Reloading line was brought in private for a specific thread. Most lines are brought in shared for all eight thrreads. If RA does not match then invalidates and then brings it shared to other thread. In P7 line brought in private , then line was invalidat",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x5088",
    "EventName": "PM_IFU_L2_TOUCH",
    "BriefDescription": "L2 touch to update MRU on a line",
    "PublicDescription": ""
  },
  {
    "EventCode": "0x514050",
    "EventName": "PM_INST_ALL_CHIP_PUMP_CPRED",
    "BriefDescription": "Initial and Final Pump Scope was chip pump (prediction=correct) for instruction fetches and prefetches",
    "PublicDescription": "Initial and Final Pump Scope and data sourced across this scope was chip pump (prediction=correct) for an instruction fetch"
  },
  {
    "EventCode": "0x544048",
    "EventName": "PM_INST_ALL_FROM_DL2L3_MOD",
    "BriefDescription": "The processor's Instruction cache was reloaded with Modified (M) data from another chip's L2 or L3 on a different Node or Group (Distant), as this chip due to instruction fetches and prefetches",
    "PublicDescription": "The processor's Instruction cache was reloaded with Modified (M) data from another chip's L2 or L3 on a different Node or Group (Distant), as this chip due to either an instruction fetch or instruction fetch plus prefetch if MMCR1[17] is 1"
  },
  {
    "EventCode": "0x534048",
    "EventName": "PM_INST_ALL_FROM_DL2L3_SHR",
    "BriefDescription": "The processor's Instruction cache was reloaded with Shared (S) data from another chip's L2 or L3 on a different Node or Group (Distant), as this chip due to instruction fetches and prefetches",
    "PublicDescription": "The processor's Instruction cache was reloaded with Shared (S) data from another chip's L2 or L3 on a different Node or Group (Distant), as this chip due to either an instruction fetch or instruction fetch plus prefetch if MMCR1[17] is 1"
  },
  {
    "EventCode": "0x53404c",
    "EventName": "PM_INST_ALL_FROM_DL4",
    "BriefDescription": "The processor's Instruction cache was reloaded from another chip's L4 on a different Node or Group (Distant) due to instruction fetches and prefetches",
    "PublicDescription": "The processor's Instruction cache was reloaded from another chip's L4 on a different Node or Group (Distant) due to either an instruction fetch or instruction fetch plus prefetch if MMCR1[17] is 1"
  },
  {
    "EventCode": "0x54404c",
    "EventName": "PM_INST_ALL_FROM_DMEM",
    "BriefDescription": "The processor's Instruction cache was reloaded from another chip's memory on the same Node or Group (Distant) due to instruction fetches and prefetches",
    "PublicDescription": "The processor's Instruction cache was reloaded from another chip's memory on the same Node or Group (Distant) due to either an instruction fetch or instruction fetch plus prefetch if MMCR1[17] is 1"
  },
  {
    "EventCode": "0x514042",
    "EventName": "PM_INST_ALL_FROM_L2",
    "BriefDescription": "The processor's Instruction cache was reloaded from local core's L2 due to instruction fetches and prefetches",
    "PublicDescription": "The processor's Instruction cache was reloaded from local core's L2 due to either an instruction fetch or instruction fetch plus prefetch if MMCR1[17] is 1"
  },
  {
    "EventCode": "0x544046",
    "EventName": "PM_INST_ALL_FROM_L21_MOD",
    "BriefDescription": "The processor's Instruction cache was reloaded with Modified (M) data from another core's L2 on the same chip due to instruction fetches and prefetches",
    "PublicDescription": "The processor's Instruction cache was reloaded with Modified (M) data from another core's L2 on the same chip due to either an instruction fetch or instruction fetch plus prefetch if MMCR1[17] is 1"
  },
  {
    "EventCode": "0x534046",
    "EventName": "PM_INST_ALL_FROM_L21_SHR",
    "BriefDescription": "The processor's Instruction cache was reloaded with Shared (S) data from another core's L2 on the same chip due to instruction fetches and prefetches",
    "PublicDescription": "The processor's Instruction cache was reloaded with Shared (S) data from another core's L2 on the same chip due to either an instruction fetch or instruction fetch plus prefetch if MMCR1[17] is 1"
  },
  {
    "EventCode": "0x51404e",
    "EventName": "PM_INST_ALL_FROM_L2MISS",
    "BriefDescription": "The processor's Instruction cache was reloaded from a location other than the local core's L2 due to instruction fetches and prefetches",
    "PublicDescription": "The processor's Instruction cache was reloaded from a location other than the local core's L2 due to either an instruction fetch or instruction fetch plus prefetch if MMCR1[17] is 1"
  },
  {
    "EventCode": "0x534040",
    "EventName": "PM_INST_ALL_FROM_L2_DISP_CONFLICT_LDHITST",
    "BriefDescription": "The processor's Instruction cache was reloaded from local core's L2 with load hit store conflict due to instruction fetches and prefetches",
    "PublicDescription": "The processor's Instruction cache was reloaded from local core's L2 with load hit store conflict due to either an instruction fetch or instruction fetch plus prefetch if MMCR1[17] is 1"
  },
  {
    "EventCode": "0x544040",
    "EventName": "PM_INST_ALL_FROM_L2_DISP_CONFLICT_OTHER",
    "BriefDescription": "The processor's Instruction cache was reloaded from local core's L2 with dispatch conflict due to instruction fetches and prefetches",
    "PublicDescription": "The processor's Instruction cache was reloaded from local core's L2 with dispatch conflict due to either an instruction fetch or instruction fetch plus prefetch if MMCR1[17] is 1"
  },
  {
    "EventCode": "0x524040",
    "EventName": "PM_INST_ALL_FROM_L2_MEPF",
    "BriefDescription": "The processor's Instruction cache was reloaded from local core's L2 hit without dispatch conflicts on Mepf state. due to instruction fetches and prefetches",
    "PublicDescription": "The processor's Instruction cache was reloaded from local core's L2 hit without dispatch conflicts on Mepf state. due to either an instruction fetch or instruction fetch plus prefetch if MMCR1[17] is 1"
  },
  {
    "EventCode": "0x514040",
    "EventName": "PM_INST_ALL_FROM_L2_NO_CONFLICT",
    "BriefDescription": "The processor's Instruction cache was reloaded from local core's L2 without conflict due to instruction fetches and prefetches",
    "PublicDescription": "The processor's Instruction cache was reloaded from local core's L2 without conflict due to either an instruction fetch or instruction fetch plus prefetch if MMCR1[17] is 1"
  },
  {
    "EventCode": "0x544042",
    "EventName": "PM_INST_ALL_FROM_L3",
    "BriefDescription": "The processor's Instruction cache was reloaded from local core's L3 due to instruction fetches and prefetches",
    "PublicDescription": "The processor's Instruction cache was reloaded from local core's L3 due to either an instruction fetch or instruction fetch plus prefetch if MMCR1[17] is 1"
  },
  {
    "EventCode": "0x544044",
    "EventName": "PM_INST_ALL_FROM_L31_ECO_MOD",
    "BriefDescription": "The processor's Instruction cache was reloaded with Modified (M) data from another core's ECO L3 on the same chip due to instruction fetches and prefetches",
    "PublicDescription": "The processor's Instruction cache was reloaded with Modified (M) data from another core's ECO L3 on the same chip due to either an instruction fetch or instruction fetch plus prefetch if MMCR1[17] is 1"
  },
  {
    "EventCode": "0x534044",
    "EventName": "PM_INST_ALL_FROM_L31_ECO_SHR",
    "BriefDescription": "The processor's Instruction cache was reloaded with Shared (S) data from another core's ECO L3 on the same chip due to instruction fetches and prefetches",
    "PublicDescription": "The processor's Instruction cache was reloaded with Shared (S) data from another core's ECO L3 on the same chip due to either an instruction fetch or instruction fetch plus prefetch if MMCR1[17] is 1"
  },
  {
    "EventCode": "0x524044",
    "EventName": "PM_INST_ALL_FROM_L31_MOD",
    "BriefDescription": "The processor's Instruction cache was reloaded with Modified (M) data from another core's L3 on the same chip due to instruction fetches and prefetches",
    "PublicDescription": "The processor's Instruction cache was reloaded with Modified (M) data from another core's L3 on the same chip due to either an instruction fetch or instruction fetch plus prefetch if MMCR1[17] is 1"
  },
  {
    "EventCode": "0x514046",
    "EventName": "PM_INST_ALL_FROM_L31_SHR",
    "BriefDescription": "The processor's Instruction cache was reloaded with Shared (S) data from another core's L3 on the same chip due to instruction fetches and prefetches",
    "PublicDescription": "The processor's Instruction cache was reloaded with Shared (S) data from another core's L3 on the same chip due to either an instruction fetch or instruction fetch plus prefetch if MMCR1[17] is 1"
  },
  {
    "EventCode": "0x54404e",
    "EventName": "PM_INST_ALL_FROM_L3MISS_MOD",
    "BriefDescription": "The processor's Instruction cache was reloaded from a location other than the local core's L3 due to a instruction fetch",
    "PublicDescription": "The processor's Instruction cache was reloaded from a location other than the local core's L3 due to either an instruction fetch or instruction fetch plus prefetch if MMCR1[17] is 1"
  },
  {
    "EventCode": "0x534042",
    "EventName": "PM_INST_ALL_FROM_L3_DISP_CONFLICT",
    "BriefDescription": "The processor's Instruction cache was reloaded from local core's L3 with dispatch conflict due to instruction fetches and prefetches",
--> --------------------

--> maximum size reached

--> --------------------