Quelle  ipq6018.dtsi   Sprache: unbekannt

// SPDX-License-Identifier: (GPL-2.0+ OR BSD-3-Clause)
/*
 * IPQ6018 SoC device tree source
 *
 * Copyright (c) 2019, The Linux Foundation. All rights reserved.
 */

#include <dt-bindings/interrupt-controller/arm-gic.h>
#include <dt-bindings/clock/qcom,gcc-ipq6018.h>
#include <dt-bindings/reset/qcom,gcc-ipq6018.h>
#include <dt-bindings/clock/qcom,apss-ipq.h>
#include <dt-bindings/thermal/thermal.h>

/ {
 #address-cells = <2>;
 #size-cells = <2>;
 interrupt-parent = <&intc>;

 clocks {
  sleep_clk: sleep-clk {
   compatible = "fixed-clock";
   clock-frequency = <32000>;
   #clock-cells = <0>;
  };

  xo: xo {
   compatible = "fixed-clock";
   clock-frequency = <24000000>;
   #clock-cells = <0>;
  };
 };

 cpus: cpus {
  #address-cells = <1>;
  #size-cells = <0>;

  cpu0: cpu@0 {
   device_type = "cpu";
   compatible = "arm,cortex-a53";
   reg = <0x0>;
   enable-method = "psci";
   next-level-cache = <&l2_0>;
   clocks = <&apcs_glb APCS_ALIAS0_CORE_CLK>;
   clock-names = "cpu";
   operating-points-v2 = <&cpu_opp_table>;
   #cooling-cells = <2>;
  };

  cpu1: cpu@1 {
   device_type = "cpu";
   compatible = "arm,cortex-a53";
   enable-method = "psci";
   reg = <0x1>;
   next-level-cache = <&l2_0>;
   clocks = <&apcs_glb APCS_ALIAS0_CORE_CLK>;
   clock-names = "cpu";
   operating-points-v2 = <&cpu_opp_table>;
   #cooling-cells = <2>;
  };

  cpu2: cpu@2 {
   device_type = "cpu";
   compatible = "arm,cortex-a53";
   enable-method = "psci";
   reg = <0x2>;
   next-level-cache = <&l2_0>;
   clocks = <&apcs_glb APCS_ALIAS0_CORE_CLK>;
   clock-names = "cpu";
   operating-points-v2 = <&cpu_opp_table>;
   #cooling-cells = <2>;
  };

  cpu3: cpu@3 {
   device_type = "cpu";
   compatible = "arm,cortex-a53";
   enable-method = "psci";
   reg = <0x3>;
   next-level-cache = <&l2_0>;
   clocks = <&apcs_glb APCS_ALIAS0_CORE_CLK>;
   clock-names = "cpu";
   operating-points-v2 = <&cpu_opp_table>;
   #cooling-cells = <2>;
  };

  l2_0: l2-cache {
   compatible = "cache";
   cache-level = <2>;
   cache-unified;
  };
 };

 firmware {
  scm {
   compatible = "qcom,scm-ipq6018", "qcom,scm";
   qcom,dload-mode = <&tcsr 0x6100>;
  };
 };

 cpu_opp_table: opp-table-cpu {
  compatible = "operating-points-v2-kryo-cpu";
  nvmem-cells = <&cpu_speed_bin>;
  opp-shared;

  opp-864000000 {
   opp-hz = /bits/ 64 <864000000>;
   opp-microvolt = <725000>;
   opp-supported-hw = <0xf>;
   clock-latency-ns = <200000>;
  };

  opp-1056000000 {
   opp-hz = /bits/ 64 <1056000000>;
   opp-microvolt = <787500>;
   opp-supported-hw = <0xf>;
   clock-latency-ns = <200000>;
  };

  opp-1200000000 {
   opp-hz = /bits/ 64 <1200000000>;
   opp-microvolt = <850000>;
   opp-supported-hw = <0x4>;
   clock-latency-ns = <200000>;
  };

  opp-1320000000 {
   opp-hz = /bits/ 64 <1320000000>;
   opp-microvolt = <862500>;
   opp-supported-hw = <0x3>;
   clock-latency-ns = <200000>;
  };

  opp-1440000000 {
   opp-hz = /bits/ 64 <1440000000>;
   opp-microvolt = <925000>;
   opp-supported-hw = <0x3>;
   clock-latency-ns = <200000>;
  };

  opp-1512000000 {
   opp-hz = /bits/ 64 <1512000000>;
   opp-microvolt = <937500>;
   opp-supported-hw = <0x2>;
   clock-latency-ns = <200000>;
  };

  opp-1608000000 {
   opp-hz = /bits/ 64 <1608000000>;
   opp-microvolt = <987500>;
   opp-supported-hw = <0x1>;
   clock-latency-ns = <200000>;
  };

  opp-1800000000 {
   opp-hz = /bits/ 64 <1800000000>;
   opp-microvolt = <1062500>;
   opp-supported-hw = <0x1>;
   clock-latency-ns = <200000>;
  };
 };

 pmuv8: pmu {
  compatible = "arm,cortex-a53-pmu";
  interrupts = <GIC_PPI 7 (GIC_CPU_MASK_SIMPLE(4) | IRQ_TYPE_LEVEL_HIGH)>;
 };

 psci: psci {
  compatible = "arm,psci-1.0";
  method = "smc";
 };

 rpm: remoteproc {
  compatible = "qcom,ipq6018-rpm-proc", "qcom,rpm-proc";

  glink-edge {
   compatible = "qcom,glink-rpm";
   interrupts = <GIC_SPI 168 IRQ_TYPE_EDGE_RISING>;
   qcom,rpm-msg-ram = <&rpm_msg_ram>;
   mboxes = <&apcs_glb 0>;

   rpm_requests: rpm-requests {
    compatible = "qcom,rpm-ipq6018", "qcom,glink-smd-rpm";
    qcom,glink-channels = "rpm_requests";
   };
  };
 };

 reserved-memory {
  #address-cells = <2>;
  #size-cells = <2>;
  ranges;

  rpm_msg_ram: memory@60000 {
   reg = <0x0 0x00060000 0x0 0x6000>;
   no-map;
  };

  bootloader@4a100000 {
   reg = <0x0 0x4a100000 0x0 0x400000>;
   no-map;
  };

  sbl@4a500000 {
   reg = <0x0 0x4a500000 0x0 0x100000>;
   no-map;
  };

  tz: memory@4a600000 {
   reg = <0x0 0x4a600000 0x0 0x400000>;
   no-map;
  };

  smem_region: memory@4aa00000 {
   compatible = "qcom,smem";
   reg = <0x0 0x4aa00000 0x0 0x100000>;
   no-map;

   hwlocks = <&tcsr_mutex 3>;
  };

  q6_region: memory@4ab00000 {
   reg = <0x0 0x4ab00000 0x0 0x5500000>;
   no-map;
  };
 };

 soc: soc@0 {
  #address-cells = <2>;
  #size-cells = <2>;
  ranges = <0 0 0 0 0x0 0xffffffff>;
  dma-ranges;
  compatible = "simple-bus";

  qusb_phy_1: qusb@59000 {
   compatible = "qcom,ipq6018-qusb2-phy";
   reg = <0x0 0x00059000 0x0 0x180>;
   #phy-cells = <0>;

   clocks = <&gcc GCC_USB1_PHY_CFG_AHB_CLK>,
     <&xo>;
   clock-names = "cfg_ahb", "ref";

   resets = <&gcc GCC_QUSB2_1_PHY_BCR>;
   status = "disabled";
  };

  ssphy_0: ssphy@78000 {
   compatible = "qcom,ipq6018-qmp-usb3-phy";
   reg = <0x0 0x00078000 0x0 0x1000>;

   clocks = <&gcc GCC_USB0_AUX_CLK>,
     <&xo>,
     <&gcc GCC_USB0_PHY_CFG_AHB_CLK>,
     <&gcc GCC_USB0_PIPE_CLK>;
   clock-names = "aux",
          "ref",
          "cfg_ahb",
          "pipe";
   clock-output-names = "gcc_usb0_pipe_clk_src";
   #clock-cells = <0>;
   #phy-cells = <0>;

   resets = <&gcc GCC_USB0_PHY_BCR>,
     <&gcc GCC_USB3PHY_0_PHY_BCR>;
   reset-names = "phy",
          "phy_phy";

   status = "disabled";
  };

  qusb_phy_0: qusb@79000 {
   compatible = "qcom,ipq6018-qusb2-phy";
   reg = <0x0 0x00079000 0x0 0x180>;
   #phy-cells = <0>;

   clocks = <&gcc GCC_USB0_PHY_CFG_AHB_CLK>,
    <&xo>;
   clock-names = "cfg_ahb", "ref";

   resets = <&gcc GCC_QUSB2_0_PHY_BCR>;
   status = "disabled";
  };

  pcie_phy: phy@84000 {
   compatible = "qcom,ipq6018-qmp-pcie-phy";
   reg = <0x0 0x00084000 0x0 0x1000>;
   status = "disabled";

   clocks = <&gcc GCC_PCIE0_AUX_CLK>,
    <&gcc GCC_PCIE0_AHB_CLK>,
    <&gcc GCC_PCIE0_PIPE_CLK>;
   clock-names = "aux",
          "cfg_ahb",
          "pipe";

   clock-output-names = "gcc_pcie0_pipe_clk_src";
   #clock-cells = <0>;

   #phy-cells = <0>;

   resets = <&gcc GCC_PCIE0_PHY_BCR>,
    <&gcc GCC_PCIE0PHY_PHY_BCR>;
   reset-names = "phy",
          "common";
  };

  mdio: mdio@90000 {
   #address-cells = <1>;
   #size-cells = <0>;
   compatible = "qcom,ipq6018-mdio", "qcom,ipq4019-mdio";
   reg = <0x0 0x00090000 0x0 0x64>;
   clocks = <&gcc GCC_MDIO_AHB_CLK>;
   clock-names = "gcc_mdio_ahb_clk";
   status = "disabled";
  };

  qfprom: efuse@a4000 {
   compatible = "qcom,ipq6018-qfprom", "qcom,qfprom";
   reg = <0x0 0x000a4000 0x0 0x2000>;
   #address-cells = <1>;
   #size-cells = <1>;

   cpu_speed_bin: cpu-speed-bin@135 {
    reg = <0x135 0x1>;
    bits = <7 1>;
   };
  };

  prng: qrng@e3000 {
   compatible = "qcom,prng-ee";
   reg = <0x0 0x000e3000 0x0 0x1000>;
   clocks = <&gcc GCC_PRNG_AHB_CLK>;
   clock-names = "core";
  };

  tsens: thermal-sensor@4a9000 {
   compatible = "qcom,ipq6018-tsens", "qcom,ipq8074-tsens";
   reg = <0x0 0x004a9000 0x0 0x1000>,
         <0x0 0x004a8000 0x0 0x1000>;
   interrupts = <GIC_SPI 184 IRQ_TYPE_LEVEL_HIGH>;
   interrupt-names = "combined";
   #qcom,sensors = <16>;
   #thermal-sensor-cells = <1>;
  };

  cryptobam: dma-controller@704000 {
   compatible = "qcom,bam-v1.7.0";
   reg = <0x0 0x00704000 0x0 0x20000>;
   interrupts = <GIC_SPI 207 IRQ_TYPE_LEVEL_HIGH>;
   clocks = <&gcc GCC_CRYPTO_AHB_CLK>;
   clock-names = "bam_clk";
   #dma-cells = <1>;
   qcom,ee = <1>;
   qcom,controlled-remotely;
  };

  crypto: crypto@73a000 {
   compatible = "qcom,crypto-v5.1";
   reg = <0x0 0x0073a000 0x0 0x6000>;
   clocks = <&gcc GCC_CRYPTO_AHB_CLK>,
     <&gcc GCC_CRYPTO_AXI_CLK>,
     <&gcc GCC_CRYPTO_CLK>;
   clock-names = "iface", "bus", "core";
   dmas = <&cryptobam 2>, <&cryptobam 3>;
   dma-names = "rx", "tx";
  };

  tlmm: pinctrl@1000000 {
   compatible = "qcom,ipq6018-pinctrl";
   reg = <0x0 0x01000000 0x0 0x300000>;
   interrupts = <GIC_SPI 208 IRQ_TYPE_LEVEL_HIGH>;
   gpio-controller;
   #gpio-cells = <2>;
   gpio-ranges = <&tlmm 0 0 80>;
   interrupt-controller;
   #interrupt-cells = <2>;

   serial_3_pins: serial3-state {
    pins = "gpio44", "gpio45";
    function = "blsp2_uart";
    drive-strength = <8>;
    bias-pull-down;
   };

   qpic_pins: qpic-state {
    pins = "gpio1", "gpio3", "gpio4",
     "gpio5", "gpio6", "gpio7",
     "gpio8", "gpio10", "gpio11",
     "gpio12", "gpio13", "gpio14",
     "gpio15", "gpio17";
    function = "qpic_pad";
    drive-strength = <8>;
    bias-disable;
   };
  };

  gcc: clock-controller@1800000 {
   compatible = "qcom,gcc-ipq6018";
   reg = <0x0 0x01800000 0x0 0x80000>;
   clocks = <&xo>, <&sleep_clk>;
   clock-names = "xo", "sleep_clk";
   #clock-cells = <1>;
   #reset-cells = <1>;
  };

  tcsr_mutex: hwlock@1905000 {
   compatible = "qcom,ipq6018-tcsr-mutex", "qcom,tcsr-mutex";
   reg = <0x0 0x01905000 0x0 0x20000>;
   #hwlock-cells = <1>;
  };

  tcsr: syscon@1937000 {
   compatible = "qcom,tcsr-ipq6018", "syscon";
   reg = <0x0 0x01937000 0x0 0x21000>;
  };

  usb2: usb@70f8800 {
   compatible = "qcom,ipq6018-dwc3", "qcom,dwc3";
   reg = <0x0 0x070f8800 0x0 0x400>;
   #address-cells = <2>;
   #size-cells = <2>;
   ranges;
   clocks = <&gcc GCC_USB1_MASTER_CLK>,
     <&gcc GCC_USB1_SLEEP_CLK>,
     <&gcc GCC_USB1_MOCK_UTMI_CLK>;
   clock-names = "core",
          "sleep",
          "mock_utmi";

   assigned-clocks = <&gcc GCC_USB1_MASTER_CLK>,
       <&gcc GCC_USB1_MOCK_UTMI_CLK>;
   assigned-clock-rates = <133330000>,
            <24000000>;

   interrupts = <GIC_SPI 128 IRQ_TYPE_LEVEL_HIGH>,
         <GIC_SPI 130 IRQ_TYPE_LEVEL_HIGH>;
   interrupt-names = "pwr_event",
       "qusb2_phy";

   resets = <&gcc GCC_USB1_BCR>;
   status = "disabled";

   dwc_1: usb@7000000 {
    compatible = "snps,dwc3";
    reg = <0x0 0x07000000 0x0 0xcd00>;
    interrupts = <GIC_SPI 99 IRQ_TYPE_LEVEL_HIGH>;
    phys = <&qusb_phy_1>;
    phy-names = "usb2-phy";
    tx-fifo-resize;
    snps,is-utmi-l1-suspend;
    snps,hird-threshold = /bits/ 8 <0x0>;
    snps,dis_u2_susphy_quirk;
    snps,dis_u3_susphy_quirk;
    dr_mode = "host";
   };
  };

  sdhc: mmc@7804000 {
   compatible = "qcom,ipq6018-sdhci", "qcom,sdhci-msm-v5";
   reg = <0x0 0x07804000 0x0 0x1000>,
         <0x0 0x07805000 0x0 0x1000>;
   reg-names = "hc", "cqhci";

   interrupts = <GIC_SPI 123 IRQ_TYPE_LEVEL_HIGH>,
         <GIC_SPI 138 IRQ_TYPE_LEVEL_HIGH>;
   interrupt-names = "hc_irq", "pwr_irq";

   clocks = <&gcc GCC_SDCC1_AHB_CLK>,
     <&gcc GCC_SDCC1_APPS_CLK>,
     <&xo>;
   clock-names = "iface", "core", "xo";
   resets = <&gcc GCC_SDCC1_BCR>;
   max-frequency = <192000000>;
   status = "disabled";
  };

  blsp_dma: dma-controller@7884000 {
   compatible = "qcom,bam-v1.7.0";
   reg = <0x0 0x07884000 0x0 0x2b000>;
   interrupts = <GIC_SPI 238 IRQ_TYPE_LEVEL_HIGH>;
   clocks = <&gcc GCC_BLSP1_AHB_CLK>;
   clock-names = "bam_clk";
   #dma-cells = <1>;
   qcom,ee = <0>;
  };

  blsp1_uart1: serial@78af000 {
   compatible = "qcom,msm-uartdm-v1.4", "qcom,msm-uartdm";
   reg = <0x0 0x78af000 0x0 0x200>;
   interrupts = <GIC_SPI 107 IRQ_TYPE_LEVEL_HIGH>;
   clocks = <&gcc GCC_BLSP1_UART1_APPS_CLK>,
     <&gcc GCC_BLSP1_AHB_CLK>;
   clock-names = "core", "iface";
   status = "disabled";
  };

  blsp1_uart2: serial@78b0000 {
   compatible = "qcom,msm-uartdm-v1.4", "qcom,msm-uartdm";
   reg = <0x0 0x78b0000 0x0 0x200>;
   interrupts = <GIC_SPI 108 IRQ_TYPE_LEVEL_HIGH>;
   clocks = <&gcc GCC_BLSP1_UART2_APPS_CLK>,
     <&gcc GCC_BLSP1_AHB_CLK>;
   clock-names = "core", "iface";
   status = "disabled";
  };

  blsp1_uart3: serial@78b1000 {
   compatible = "qcom,msm-uartdm-v1.4", "qcom,msm-uartdm";
   reg = <0x0 0x078b1000 0x0 0x200>;
   interrupts = <GIC_SPI 306 IRQ_TYPE_LEVEL_HIGH>;
   clocks = <&gcc GCC_BLSP1_UART3_APPS_CLK>,
     <&gcc GCC_BLSP1_AHB_CLK>;
   clock-names = "core", "iface";
   status = "disabled";
  };

  blsp1_uart4: serial@78b2000 {
   compatible = "qcom,msm-uartdm-v1.4", "qcom,msm-uartdm";
   reg = <0x0 0x078b2000 0x0 0x200>;
   interrupts = <GIC_SPI 307 IRQ_TYPE_LEVEL_HIGH>;
   clocks = <&gcc GCC_BLSP1_UART4_APPS_CLK>,
     <&gcc GCC_BLSP1_AHB_CLK>;
   clock-names = "core", "iface";
   status = "disabled";
  };

  blsp1_uart5: serial@78b3000 {
   compatible = "qcom,msm-uartdm-v1.4", "qcom,msm-uartdm";
   reg = <0x0 0x78b3000 0x0 0x200>;
   interrupts = <GIC_SPI 308 IRQ_TYPE_LEVEL_HIGH>;
   clocks = <&gcc GCC_BLSP1_UART5_APPS_CLK>,
     <&gcc GCC_BLSP1_AHB_CLK>;
   clock-names = "core", "iface";
   status = "disabled";
  };

  blsp1_uart6: serial@78b4000 {
   compatible = "qcom,msm-uartdm-v1.4", "qcom,msm-uartdm";
   reg = <0x0 0x078b4000 0x0 0x200>;
   interrupts = <GIC_SPI 309 IRQ_TYPE_LEVEL_HIGH>;
   clocks = <&gcc GCC_BLSP1_UART6_APPS_CLK>,
     <&gcc GCC_BLSP1_AHB_CLK>;
   clock-names = "core", "iface";
   status = "disabled";
  };

  blsp1_spi1: spi@78b5000 {
   compatible = "qcom,spi-qup-v2.2.1";
   #address-cells = <1>;
   #size-cells = <0>;
   reg = <0x0 0x078b5000 0x0 0x600>;
   interrupts = <GIC_SPI 95 IRQ_TYPE_LEVEL_HIGH>;
   clocks = <&gcc GCC_BLSP1_QUP1_SPI_APPS_CLK>,
     <&gcc GCC_BLSP1_AHB_CLK>;
   clock-names = "core", "iface";
   dmas = <&blsp_dma 12>, <&blsp_dma 13>;
   dma-names = "tx", "rx";
   status = "disabled";
  };

  blsp1_spi2: spi@78b6000 {
   compatible = "qcom,spi-qup-v2.2.1";
   #address-cells = <1>;
   #size-cells = <0>;
   reg = <0x0 0x078b6000 0x0 0x600>;
   interrupts = <GIC_SPI 96 IRQ_TYPE_LEVEL_HIGH>;
   clocks = <&gcc GCC_BLSP1_QUP2_SPI_APPS_CLK>,
     <&gcc GCC_BLSP1_AHB_CLK>;
   clock-names = "core", "iface";
   dmas = <&blsp_dma 14>, <&blsp_dma 15>;
   dma-names = "tx", "rx";
   status = "disabled";
  };

  blsp1_spi5: spi@78b9000 {
   compatible = "qcom,spi-qup-v2.2.1";
   #address-cells = <1>;
   #size-cells = <0>;
   reg = <0x0 0x078b9000 0x0 0x600>;
   interrupts = <GIC_SPI 299 IRQ_TYPE_LEVEL_HIGH>;
   clocks = <&gcc GCC_BLSP1_QUP5_SPI_APPS_CLK>,
     <&gcc GCC_BLSP1_AHB_CLK>;
   clock-names = "core", "iface";
   dmas = <&blsp_dma 20>, <&blsp_dma 21>;
   dma-names = "tx", "rx";
   status = "disabled";
  };

  blsp1_i2c2: i2c@78b6000 {
   compatible = "qcom,i2c-qup-v2.2.1";
   #address-cells = <1>;
   #size-cells = <0>;
   reg = <0x0 0x078b6000 0x0 0x600>;
   interrupts = <GIC_SPI 96 IRQ_TYPE_LEVEL_HIGH>;
   clocks = <&gcc GCC_BLSP1_QUP2_I2C_APPS_CLK>,
     <&gcc GCC_BLSP1_AHB_CLK>;
   clock-names = "core", "iface";
   clock-frequency = <400000>;
   dmas = <&blsp_dma 14>, <&blsp_dma 15>;
   dma-names = "tx", "rx";
   status = "disabled";
  };

  blsp1_i2c3: i2c@78b7000 {
   compatible = "qcom,i2c-qup-v2.2.1";
   #address-cells = <1>;
   #size-cells = <0>;
   reg = <0x0 0x078b7000 0x0 0x600>;
   interrupts = <GIC_SPI 97 IRQ_TYPE_LEVEL_HIGH>;
   clocks = <&gcc GCC_BLSP1_QUP3_I2C_APPS_CLK>,
     <&gcc GCC_BLSP1_AHB_CLK>;
   clock-names = "core", "iface";
   clock-frequency = <400000>;
   dmas = <&blsp_dma 16>, <&blsp_dma 17>;
   dma-names = "tx", "rx";
   status = "disabled";
  };

  blsp1_i2c6: i2c@78ba000 {
   compatible = "qcom,i2c-qup-v2.2.1";
   #address-cells = <1>;
   #size-cells = <0>;
   reg = <0x0 0x078ba000 0x0 0x600>;
   interrupts = <GIC_SPI 300 IRQ_TYPE_LEVEL_HIGH>;
   clocks = <&gcc GCC_BLSP1_QUP6_I2C_APPS_CLK>,
          <&gcc GCC_BLSP1_AHB_CLK>;
   clock-names = "core", "iface";
   clock-frequency = <400000>;
   dmas = <&blsp_dma 22>, <&blsp_dma 23>;
   dma-names = "tx", "rx";
   status = "disabled";
  };

  qpic_bam: dma-controller@7984000 {
   compatible = "qcom,bam-v1.7.0";
   reg = <0x0 0x07984000 0x0 0x1a000>;
   interrupts = <GIC_SPI 146 IRQ_TYPE_LEVEL_HIGH>;
   clocks = <&gcc GCC_QPIC_AHB_CLK>;
   clock-names = "bam_clk";
   #dma-cells = <1>;
   qcom,ee = <0>;
   status = "disabled";
  };

  qpic_nand: nand-controller@79b0000 {
   compatible = "qcom,ipq6018-nand";
   reg = <0x0 0x079b0000 0x0 0x10000>;
   #address-cells = <1>;
   #size-cells = <0>;
   clocks = <&gcc GCC_QPIC_CLK>,
     <&gcc GCC_QPIC_AHB_CLK>;
   clock-names = "core", "aon";

   dmas = <&qpic_bam 0>,
          <&qpic_bam 1>,
          <&qpic_bam 2>;
   dma-names = "tx", "rx", "cmd";
   pinctrl-0 = <&qpic_pins>;
   pinctrl-names = "default";
   status = "disabled";
  };

  usb3: usb@8af8800 {
   compatible = "qcom,ipq6018-dwc3", "qcom,dwc3";
   reg = <0x0 0x08af8800 0x0 0x400>;
   #address-cells = <2>;
   #size-cells = <2>;
   ranges;

   clocks = <&gcc GCC_SYS_NOC_USB0_AXI_CLK>,
    <&gcc GCC_USB0_MASTER_CLK>,
    <&gcc GCC_USB0_SLEEP_CLK>,
    <&gcc GCC_USB0_MOCK_UTMI_CLK>;
   clock-names = "cfg_noc",
    "core",
    "sleep",
    "mock_utmi";

   assigned-clocks = <&gcc GCC_SYS_NOC_USB0_AXI_CLK>,
       <&gcc GCC_USB0_MASTER_CLK>,
       <&gcc GCC_USB0_MOCK_UTMI_CLK>;
   assigned-clock-rates = <133330000>,
            <133330000>,
            <24000000>;

   interrupts = <GIC_SPI 134 IRQ_TYPE_LEVEL_HIGH>,
         <GIC_SPI 136 IRQ_TYPE_LEVEL_HIGH>,
         <GIC_SPI 220 IRQ_TYPE_LEVEL_HIGH>;
   interrupt-names = "pwr_event",
       "qusb2_phy",
       "ss_phy_irq";

   resets = <&gcc GCC_USB0_BCR>;
   status = "disabled";

   dwc_0: usb@8a00000 {
    compatible = "snps,dwc3";
    reg = <0x0 0x08a00000 0x0 0xcd00>;
    interrupts = <GIC_SPI 140 IRQ_TYPE_LEVEL_HIGH>;
    phys = <&qusb_phy_0>, <&ssphy_0>;
    phy-names = "usb2-phy", "usb3-phy";
    clocks = <&xo>;
    clock-names = "ref";
    tx-fifo-resize;
    snps,parkmode-disable-ss-quirk;
    snps,is-utmi-l1-suspend;
    snps,hird-threshold = /bits/ 8 <0x0>;
    snps,dis_u2_susphy_quirk;
    snps,dis_u3_susphy_quirk;
    dr_mode = "host";
   };
  };

  intc: interrupt-controller@b000000 {
   compatible = "qcom,msm-qgic2";
   #address-cells = <2>;
   #size-cells = <2>;
   interrupt-controller;
   #interrupt-cells = <3>;
   reg = <0x0 0x0b000000 0x0 0x1000>,  /*GICD*/
         <0x0 0x0b002000 0x0 0x1000>,  /*GICC*/
         <0x0 0x0b001000 0x0 0x1000>,  /*GICH*/
         <0x0 0x0b004000 0x0 0x1000>;  /*GICV*/
   interrupts = <GIC_PPI 9 IRQ_TYPE_LEVEL_HIGH>;
   ranges = <0 0 0 0xb00a000 0 0xffd>;

   v2m@0 {
    compatible = "arm,gic-v2m-frame";
    msi-controller;
    reg = <0x0 0x0 0x0 0xffd>;
   };
  };

  watchdog@b017000 {
   compatible = "qcom,kpss-wdt";
   interrupts = <GIC_SPI 3 IRQ_TYPE_EDGE_RISING>;
   reg = <0x0 0x0b017000 0x0 0x40>;
   clocks = <&sleep_clk>;
   timeout-sec = <10>;
  };

  apcs_glb: mailbox@b111000 {
   compatible = "qcom,ipq6018-apcs-apps-global";
   reg = <0x0 0x0b111000 0x0 0x1000>;
   #clock-cells = <1>;
   clocks = <&a53pll>, <&xo>, <&gcc GPLL0>;
   clock-names = "pll", "xo", "gpll0";
   #mbox-cells = <1>;
  };

  a53pll: clock@b116000 {
   compatible = "qcom,ipq6018-a53pll";
   reg = <0x0 0x0b116000 0x0 0x40>;
   #clock-cells = <0>;
   clocks = <&xo>;
   clock-names = "xo";
  };

  timer@b120000 {
   #address-cells = <1>;
   #size-cells = <1>;
   ranges = <0 0 0 0x10000000>;
   compatible = "arm,armv7-timer-mem";
   reg = <0x0 0x0b120000 0x0 0x1000>;

   frame@b120000 {
    frame-number = <0>;
    interrupts = <GIC_SPI 8 IRQ_TYPE_LEVEL_HIGH>,
          <GIC_SPI 7 IRQ_TYPE_LEVEL_HIGH>;
    reg = <0x0b121000 0x1000>,
          <0x0b122000 0x1000>;
   };

   frame@b123000 {
    frame-number = <1>;
    interrupts = <GIC_SPI 9 IRQ_TYPE_LEVEL_HIGH>;
    reg = <0x0b123000 0x1000>;
    status = "disabled";
   };

   frame@b124000 {
    frame-number = <2>;
    interrupts = <GIC_SPI 10 IRQ_TYPE_LEVEL_HIGH>;
    reg = <0x0b124000 0x1000>;
    status = "disabled";
   };

   frame@b125000 {
    frame-number = <3>;
    interrupts = <GIC_SPI 11 IRQ_TYPE_LEVEL_HIGH>;
    reg = <0x0b125000 0x1000>;
    status = "disabled";
   };

   frame@b126000 {
    frame-number = <4>;
    interrupts = <GIC_SPI 12 IRQ_TYPE_LEVEL_HIGH>;
    reg = <0x0b126000 0x1000>;
    status = "disabled";
   };

   frame@b127000 {
    frame-number = <5>;
    interrupts = <GIC_SPI 13 IRQ_TYPE_LEVEL_HIGH>;
    reg = <0x0b127000 0x1000>;
    status = "disabled";
   };

   frame@b128000 {
    frame-number = <6>;
    interrupts = <GIC_SPI 14 IRQ_TYPE_LEVEL_HIGH>;
    reg = <0x0b128000 0x1000>;
    status = "disabled";
   };
  };

  q6v5_wcss: remoteproc@cd00000 {
   compatible = "qcom,ipq6018-wcss-pil";
   reg = <0x0 0x0cd00000 0x0 0x4040>,
         <0x0 0x004ab000 0x0 0x20>;
   reg-names = "qdsp6",
        "rmb";
   interrupts-extended = <&intc GIC_SPI 325 IRQ_TYPE_EDGE_RISING>,
           <&wcss_smp2p_in 0 0>,
           <&wcss_smp2p_in 1 0>,
           <&wcss_smp2p_in 2 0>,
           <&wcss_smp2p_in 3 0>;
   interrupt-names = "wdog",
       "fatal",
       "ready",
       "handover",
       "stop-ack";

   resets = <&gcc GCC_WCSSAON_RESET>,
     <&gcc GCC_WCSS_BCR>,
     <&gcc GCC_WCSS_Q6_BCR>;

   reset-names = "wcss_aon_reset",
          "wcss_reset",
          "wcss_q6_reset";

   clocks = <&gcc GCC_PRNG_AHB_CLK>;
   clock-names = "prng";

   qcom,halt-regs = <&tcsr 0x18000 0x1b000 0xe000>;

   qcom,smem-states = <&wcss_smp2p_out 0>,
        <&wcss_smp2p_out 1>;
   qcom,smem-state-names = "shutdown",
      "stop";

   memory-region = <&q6_region>;

   glink-edge {
    interrupts = <GIC_SPI 321 IRQ_TYPE_EDGE_RISING>;
    label = "rtr";
    qcom,remote-pid = <1>;
    mboxes = <&apcs_glb 8>;

    qrtr_requests {
     qcom,glink-channels = "IPCRTR";
    };
   };
  };

  pcie0: pcie@20000000 {
   compatible = "qcom,pcie-ipq6018";
   reg = <0x0 0x20000000 0x0 0xf1d>,
         <0x0 0x20000f20 0x0 0xa8>,
         <0x0 0x20001000 0x0 0x1000>,
         <0x0 0x80000 0x0 0x4000>,
         <0x0 0x20100000 0x0 0x1000>;
   reg-names = "dbi", "elbi", "atu", "parf", "config";

   device_type = "pci";
   linux,pci-domain = <0>;
   bus-range = <0x00 0xff>;
   num-lanes = <1>;
   max-link-speed = <3>;
   #address-cells = <3>;
   #size-cells = <2>;

   phys = <&pcie_phy>;
   phy-names = "pciephy";

   ranges = <0x81000000 0x0 0x00000000 0x0 0x20200000 0x0 0x10000>,
     <0x82000000 0x0 0x20220000 0x0 0x20220000 0x0 0xfde0000>;

   interrupts = <GIC_SPI 52 IRQ_TYPE_LEVEL_HIGH>,
         <GIC_SPI 55 IRQ_TYPE_LEVEL_HIGH>,
         <GIC_SPI 56 IRQ_TYPE_LEVEL_HIGH>,
         <GIC_SPI 57 IRQ_TYPE_LEVEL_HIGH>,
         <GIC_SPI 59 IRQ_TYPE_LEVEL_HIGH>,
         <GIC_SPI 63 IRQ_TYPE_LEVEL_HIGH>,
         <GIC_SPI 68 IRQ_TYPE_LEVEL_HIGH>,
         <GIC_SPI 72 IRQ_TYPE_LEVEL_HIGH>,
         <GIC_SPI 51 IRQ_TYPE_LEVEL_HIGH>;
   interrupt-names = "msi0",
       "msi1",
       "msi2",
       "msi3",
       "msi4",
       "msi5",
       "msi6",
       "msi7",
       "global";

   #interrupt-cells = <1>;
   interrupt-map-mask = <0 0 0 0x7>;
   interrupt-map = <0 0 0 1 &intc 0 0 0 75 IRQ_TYPE_LEVEL_HIGH>, /* int_a */
     <0 0 0 2 &intc 0 0 0 78 IRQ_TYPE_LEVEL_HIGH>, /* int_b */
     <0 0 0 3 &intc 0 0 0 79 IRQ_TYPE_LEVEL_HIGH>, /* int_c */
     <0 0 0 4 &intc 0 0 0 83 IRQ_TYPE_LEVEL_HIGH>; /* int_d */

   clocks = <&gcc GCC_SYS_NOC_PCIE0_AXI_CLK>,
     <&gcc GCC_PCIE0_AXI_M_CLK>,
     <&gcc GCC_PCIE0_AXI_S_CLK>,
     <&gcc GCC_PCIE0_AXI_S_BRIDGE_CLK>,
     <&gcc PCIE0_RCHNG_CLK>;
   clock-names = "iface",
          "axi_m",
          "axi_s",
          "axi_bridge",
          "rchng";

   resets = <&gcc GCC_PCIE0_PIPE_ARES>,
     <&gcc GCC_PCIE0_SLEEP_ARES>,
     <&gcc GCC_PCIE0_CORE_STICKY_ARES>,
     <&gcc GCC_PCIE0_AXI_MASTER_ARES>,
     <&gcc GCC_PCIE0_AXI_SLAVE_ARES>,
     <&gcc GCC_PCIE0_AHB_ARES>,
     <&gcc GCC_PCIE0_AXI_MASTER_STICKY_ARES>,
     <&gcc GCC_PCIE0_AXI_SLAVE_STICKY_ARES>;
   reset-names = "pipe",
          "sleep",
          "sticky",
          "axi_m",
          "axi_s",
          "ahb",
          "axi_m_sticky",
          "axi_s_sticky";

   status = "disabled";

   pcie@0 {
    device_type = "pci";
    reg = <0x0 0x0 0x0 0x0 0x0>;
    bus-range = <0x01 0xff>;

    #address-cells = <3>;
    #size-cells = <2>;
    ranges;
   };
  };
 };

 thermal-zones {
  nss-top-thermal {
   polling-delay-passive = <250>;
   thermal-sensors = <&tsens 4>;

   trips {
    nss-top-critical {
     temperature = <125000>;
     hysteresis = <1000>;
     type = "critical";
    };
   };
  };

  nss-thermal {
   polling-delay-passive = <250>;
   thermal-sensors = <&tsens 5>;

   trips {
    nss-critical {
     temperature = <125000>;
     hysteresis = <1000>;
     type = "critical";
    };
   };
  };

  wcss-phya0-thermal {
   polling-delay-passive = <250>;
   thermal-sensors = <&tsens 7>;

   trips {
    wcss-phya0-critical {
     temperature = <125000>;
     hysteresis = <1000>;
     type = "critical";
    };
   };
  };

  wcss-phya1-thermal {
   polling-delay-passive = <250>;
   polling-delay = <1000>;
   thermal-sensors = <&tsens 8>;

   trips {
    wcss-phya1-critical {
     temperature = <125000>;
     hysteresis = <1000>;
     type = "critical";
    };
   };
  };

  cpu-thermal {
   polling-delay-passive = <250>;
   thermal-sensors = <&tsens 13>;

   trips {
    cpu-critical {
     temperature = <125000>;
     hysteresis = <1000>;
     type = "critical";
    };

    cpu_alert: cpu-passive {
     temperature = <110000>;
     hysteresis = <1000>;
     type = "passive";
    };
   };

   cooling-maps {
    map0 {
     trip = <&cpu_alert>;
     cooling-device = <&cpu0 THERMAL_NO_LIMIT THERMAL_NO_LIMIT>,
        <&cpu1 THERMAL_NO_LIMIT THERMAL_NO_LIMIT>,
        <&cpu2 THERMAL_NO_LIMIT THERMAL_NO_LIMIT>,
        <&cpu3 THERMAL_NO_LIMIT THERMAL_NO_LIMIT>;
    };
   };
  };

  lpass-thermal {
   polling-delay-passive = <250>;
   thermal-sensors = <&tsens 14>;

   trips {
    lpass-critical {
     temperature = <125000>;
     hysteresis = <1000>;
     type = "critical";
    };
   };
  };

  ddrss-top-thermal {
   polling-delay-passive = <250>;
   thermal-sensors = <&tsens 15>;

   trips {
    ddrss-top-critical {
     temperature = <125000>;
     hysteresis = <1000>;
     type = "critical";
    };
   };
  };
 };

 timer {
  compatible = "arm,armv8-timer";
  interrupts = <GIC_PPI 2 (GIC_CPU_MASK_SIMPLE(4) | IRQ_TYPE_LEVEL_LOW)>,
        <GIC_PPI 3 (GIC_CPU_MASK_SIMPLE(4) | IRQ_TYPE_LEVEL_LOW)>,
        <GIC_PPI 4 (GIC_CPU_MASK_SIMPLE(4) | IRQ_TYPE_LEVEL_LOW)>,
        <GIC_PPI 1 (GIC_CPU_MASK_SIMPLE(4) | IRQ_TYPE_LEVEL_LOW)>;
 };

 wcss: wcss-smp2p {
  compatible = "qcom,smp2p";
  qcom,smem = <435>, <428>;

  interrupt-parent = <&intc>;
  interrupts = <GIC_SPI 322 IRQ_TYPE_EDGE_RISING>;

  mboxes = <&apcs_glb 9>;

  qcom,local-pid = <0>;
  qcom,remote-pid = <1>;

  wcss_smp2p_out: master-kernel {
   qcom,entry-name = "master-kernel";
   #qcom,smem-state-cells = <1>;
  };

  wcss_smp2p_in: slave-kernel {
   qcom,entry-name = "slave-kernel";
   interrupt-controller;
   #interrupt-cells = <2>;
  };
 };
};