/* System External Interrupt Mask Register */ #define SEMSR_SIRQ0 0x00008000
/* System Error Control Register */ #define SERCR_MCPR 0x00000001
struct ipic { volatile u32 __iomem *regs;
/* The remapper for this IPIC */ struct irq_domain *irqhost;
};
struct ipic_info {
u8 ack; /* pending register offset from base if the irq
supports ack operation */
u8 mask; /* mask register offset from base */
u8 prio; /* priority register offset from base */
u8 force; /* force register offset from base */
u8 bit; /* register bit position (as per doc)
bit mask = 1 << (31 - bit) */
u8 prio_mask; /* priority mask value */
};
#endif/* __IPIC_H__ */
Messung V0.5
¤ Dauer der Verarbeitung: 0.11 Sekunden
(vorverarbeitet)
¤
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Bemerkung:
Die farbliche Syntaxdarstellung und die Messung sind noch experimentell.